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Algotochip:開創 C to GDSII 的 Virtual R&D 設計服務模式 | EE World

Algotochip:開創 C to GDSII 的 Virtual R&D 設計服務模式 | EE World
2012-06-04


2012-06-04 12:22:26   來源:EEWORLD  
(本文轉自電子工程世界:http://www.eeworld.com.cn/manufacture/2012/0604/article_7372.html)

Algotochip公司的業務模式和一般意義上的design service不太一樣,一般design service是從RTL到GDSII,而Algotochip提供的,則是由C to GDSII。“我們不希望將自己稱為design service公司,而希望叫virtual R&D,因為設計服務只是簡單的外包,而我們會在芯片設計過程中提供很多決定。” 我們先來說一說Algotochip起家吧。Mike Hong,Algotochip運營和商務開發副總裁,其擁有超過30年的半導體和無線解決方案經驗,工作范疇覆蓋市場、銷售、業務拓展和經營等。 1995年左右,其作為聯合創始人用超標量cpu技術制作了著名的DSP內核ZSP,1997年將公司出售給LSI,隨后被大唐所收購。“做DSP時我們就發現從研發到量產的時間太漫長了,ZSP大概經過兩年半時間才有了第一個量產,對于半導體芯片來說,市場風險和時間成正比,所以如何把設計時間壓縮,成為我們后來一直想解決的問題,也就是C to GDSII原型。”Mike說道。 不過再出售了ZSP公司以后,幾個合伙人分別去了不同公司繼續著職業生涯,其中包括SiRF和ZSP創始人,現Algotochip CEO Tak Shigihara以及ZSP發明者,現Algotochip CTO Satish Padmanabhan。2009年,幾位重要的領導人重聚首,當年12月Algotochip引入第一筆風投,召集了五六位核心人員,開始把此概念做了一些評估和研究,2011年初引進了第二筆資金,標志著公司開始正式進入商業化運作階段。 現在,ZSP共有員工43名,其中純工程技術開發人員39名,并且均為資深級工程師。 一般意義上的RTL to GDSII,由于RTL不是自己寫的,所以基本起點有限,靈活度不夠高。而從C開始開發,Algotochip團隊就可以做許多決定,包括換方案或者其他什么。 一般情況下Design service團隊至少包括15-20人,因為需要進行DLC、LVS等開發,Mike指出Algotochip由于不需要這些步驟,因此一個團隊的配置可以縮減到6人,一個負責CPU、一個負責DSP,兩名負責專用處理器,而剩下兩名則是做后端開發。 Algotochip的開發可以被認為是工具+人腦的綜合設計結果:Algotochip有一套開發工具,可以從C to RTL,當然工具生成的RTL。工具生成的RTL會有很多種,這時Algotochip的專家會分析哪些RTL結果是好的,反饋給機器,機器加以學習。通過這種不斷地回饋學習機制,機器也會逐步的強化自身的判斷,達到真正智能化的C to RTL。以Algotochip第一個宣布成功的案例為例——mimoOn公司mi!MobilePHYTM (LTE 無線終端物理層)參考鏈的SoC芯片解決方案。在這個案例中,共有2350個C code file,400萬行命令,芯片規模達到了2300萬門。

Algotochip設計方法學 在起初的四周內,Algotochip會根據C code提供一個CPU架構,在這期間對于芯片性能,功耗以及面積有了大致評估,當然這個CPU架構會提供配套的工具,固件以及指令集代碼等。當得到客戶肯定之后,接下來的八周時間則很容易的可以進行C to RTL to GDSII的開發工作。 Mike表示,目前通訊客戶對Algotochip感興趣的比較多,一方面是他們的產品復雜,對于Algotochip來說,越復雜的產品越合適C to GDSII的設計方法。另外則是通信行業對C code的理解比較好,但是對芯片的理解能力有欠缺或者是沒有IC設計團隊的預算。 目前,Algotochip的產品可以用在幾個方面:包括ASIC,eASIC,FPGA或者一些IP公司,所以目前Algotochip也在和Xilinx及Altera談,畢竟這兩家FPGA公司也都在盡力發展C to RTL工具。 談及價格,Mike并沒有正面回答,只是表示考慮time to market的時間,Algotochip的價格絕對不算離譜。 此外,關于專利等問題,首先來說Algotochip要求客戶將C code的所有解釋,有意義的變量都刪除,其次所有的RTL、GDSII、SDK等文檔都歸客戶所有,第三,保證同一只隊伍不會繼續服務客戶的競爭。 做慣了快公司的Mike表示,未來被收購機會最大,而出售對象則會是沒有這一設計流程的半導體公司,而現在Algotochip要做的就是盡快推動芯片量產。 “你說這種設計方法學難么?其實只要花心思、有經驗就沒問題。因為我們所做的工作也都是在可實現范圍內實現的。”Mike表示。

獲取方案

您在設計什么類型的芯片?
設計中含的ASIC門容量為?
500萬 - 2千萬
2千萬 - 5千萬
5千萬 - 1億
1億 - 10億
大于10億
您傾向于使用哪款FPGA?
賽靈思 VU440
賽靈思 KU115
賽靈思 VU19P
賽靈思 VU13P
賽靈思 VU9P
AMD VP1802
AMD VP1902
英特爾 S10-10M
英特爾 S10-2800
不太確定,需要專業建議
您需要什么樣的FPGA配置?
單顆FPGA
雙顆FPGA
四顆FPGA
八顆FPGA
不太確定,需要專業建議
您需要什么樣的外設接口?
您需要多少數量的原型驗證平臺?
您是否需要以下原型驗證配套工具? (可多選)
分割工具
多FPGA調試工具
協同建模工具(允許大量數據在 FPGA 與 PC 主機之間進行交互)
您什么時間內需要使用到我們產品?
0-6個月
6-12個月
大于12個月
不太確定
您是否需要其他工具資訊?(可多選)
架構設計
軟件仿真
硬件仿真
數字調試
形式驗證
想要更多了解,您是否需要產品選型指南?
其他
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